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標題: [中央處理器] 9800x3d體質點先算優異? [打印本頁]

作者: evan11    時間: 2025-1-20 15:28     標題: 9800x3d體質點先算優異?

我個粒: pbo -45 => 5.2Ghz 6400Mhz 1:1
Pbo -35 => 5.4Ghz 6400Mhz 1:1
作者: 010    時間: 2025-1-20 23:55

比平均值好
但而家9800x3d Tjmax同non X3d一樣去到95°C
變相-co唔係咁緊要
只要唔撞牆就冇乜問題
作者: 11133034    時間: 2025-1-21 00:13

聽講9800x3d比較容易行到6400mhz
作者: evan11    時間: 2025-1-21 11:29

謝謝兩位師兄意見。
作者: akitohk    時間: 2025-1-21 14:06

本帖最後由 akitohk 於 2025-1-22 01:12 編輯

仲有SoC體質

SoC 1.125V 內穩行到6400RAM 同2200 FCLK

或者SoC 1V 行8000RAM(gear2)同2000 FCLK (FCLK 1:1 UCLK)

我依家SoC行1V, ram行緊8000C34, FCLK 1:1 UCLK =2000, latency 壓到56ns
作者: gbaxp    時間: 2025-1-21 17:29

回復 5 #akitohk

體感上係唔係真係feel到部機快左?

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作者: evan11    時間: 2025-1-21 18:08

回覆 5# akitohk


    嘩,你個粒行到8000 1:1,我都試下先。
作者: akitohk    時間: 2025-1-22 01:02

回覆  akitohk


    嘩,你個粒行到8000 1:1,我都試下先。
evan11 發表於 2025-1-21 18:08


8000 係行gear2,即係UCLK=2000 1:2 MCLK DDR5 8000(4000)
行8000因為UCLK可以1:1 FCLK, 咁個latency 可以好容易壓低,但bandwidth 唔高

你開頭6400講既1:1 係MCLK ddr5 6400(3200) = UCLK 3200,
雖然FCLK 唔可以1:1, 但拉高FCLK 就算唔同步都仲可以拉高bandwidth,可以抵消下latency 比較高

仲有另一樣就係8000個邊FCLK行2000,基本SoC電壓可以降到好低都ok
6400想拉高FCLK SoC電壓低極有限(真係視乎體質)
作者: akitohk    時間: 2025-1-22 01:11

本帖最後由 akitohk 於 2025-1-22 01:25 編輯
回復 akitohk

體感上係唔係真係feel到部機快左?

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gbaxp 發表於 2025-1-21 17:29


gaming上
6200c26 fclk2200 同8000c34 fclk2000 比較差唔多無咩分別
不過aida ram既benchmark 就前者bandwidth大啲,後者latency 好好多
同因為SoC 電壓唔同,兩者idle下都爭緊3度,同一隻game上平均8000c34個邊cpu用少6W定7W電

另外有趣既係8000c34 fclk2200,ram benchmark 個數係bandwidth靚,latency都靚(只係多1ns)
但gaming 1%low 對比8000c34 fclk2000 跌左10~15%
所以我諗行gear2 就一定要以fclk同uclk 1:1 為前題去set
7xxx 行gear2 就真係行返6xxx gear1好過
不過8000gear 2個setting non-X3D 個邊改善應該會好過x3d厘邊
X3D 個大Cache 攪到都唔洗太追ram latency
作者: qazqwe671    時間: 2025-2-4 10:31

提示: 作者被禁止或刪除 內容自動屏蔽
作者: Sun    時間: 2025-2-4 21:52

thanks info.

好多年沒砌機, 多謝超RAM資料.

有冇得MONITOR RAM有幾常寫入寫出?
作者: ray7a7    時間: 2025-2-5 12:42

超頻的終焉就係回歸預設

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